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用Verilog语言实现二进制转化为十进制，谢谢
用Verilog语言实现二进制转化为十进制，谢谢
2024-12-21 09:39:58
推荐回答（2个）
回答1：
什么意思？是二进制转bcd码吗？如果是转bcd码就在二进制的每四位判断大于9则加6进位，从低位开始。
回答2：
不明白你什么意思，verilog 的十进制也是用诸如[7:0]q实现的
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