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请问如何在fpga开发中使用verilog语言将1hz信号变为100hz？有些什么方法？谢谢！
请问如何在fpga开发中使用verilog语言将1hz信号变为100hz？有些什么方法？谢谢！
2024-12-29 23:29:46
推荐回答（3个）
回答1：
说实话1HZ有点小，你试试全数字锁相环
回答2：
倍频锁相环
回答3：
是不可以实现的
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