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使用 ModelSim仿真Xilinx的fifo核时，好几个信号出现高阻态，包括empty、full等，如下图
使用 ModelSim仿真Xilinx的fifo核时，好几个信号出现高阻态，包括empty、full等，如下图
百分之八九十情况下会出现高阻态苦恼。。。求解答
2024-11-30 02:09:18
推荐回答（1个）
回答1：
你的写使能wr_en打开了吗 从你的波形上看，你没有打开写使能啊，
向外读取数据的时候是要将读使能置为有效的，也就是将rd_en拉高，否则你是读不出来数据的，请采纳
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