74ls374是八D触发器(三态)。一个封装有八个D触发器供选用，置数全并行存取，缓冲控制输入。
D触发器（data flip-flop或delay flip-flop。）该触发器由6个与非门组成，其中G1和G2构成基本RS触发器。
电平触发的主从触发器工作时，必须在正跳沿前加入输入信号。
如果在CP
高电平期间输入端出现干扰信号，那么就有可能使触发器的状态出错。而边沿触发器允许在CP
触发沿来到前一瞬间加入输入信号。这样，输入端受干扰的时间大大缩短，受干扰的可能性就降低了。边沿D触发器也称为维持-阻塞边沿D触发器。
74ls374是八D触发器(三态).
一个封装有八个D触发器供选用.置数全并行存取.缓冲控制输入.
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